VSC8254YMR-01 ICs Ethernet INTERFACE TELECOM Interfaces de Rede Circuitos Integrados
VSC8254YMR-01 ICs Ethernet
,256 FCBGA Interfaces de Rede Circuitos Integrados
,INTERFACE TELECOM ICs Ethernet
VSC8254YMR-01 ICs Ethernet TELECOM INTERFACE 256FCBGA Interfaces de Rede Circuitos Integrados
Aplicação:
As aplicações alvo para o dispositivo VSC8254-01 incluem switching, conectividade de roteador de borda IP, conectividade de montagem em rack através de backplane, conectividade de fibra e cabo de cobre, e acesso a servidor autônomo (em designs LAN na placa-mãe ou adaptadores de rede separados). • Condicionamento de sinal serial-para-serial multi-porta com cross-connect • Transceptores de backplane compatíveis com 10GBASE-KR • Redes que requerem sincronização de tempo de alta precisão • Placas de switch 10 GbE multi-porta XFI/10GBASE-KR para SFI/SFP+, placas de roteador e adaptadores de rede Além disso, as seguintes aplicações habilitadas para MACsec são suportadas: • Criptografia, autenticação e integridade de dados em interconexões de data center externas • Conexões seguras de cliente e acesso • Timestamping IEEE 1588 em uma porta MACsec.
Visão Geral:
O dispositivo VSC8254-01 faz parte da família de produtos SynchroPHY™ da Microsemi. É um PHY Ethernet serial-para-serial de dois canais 1G/10G com a tecnologia de temporização de rede de precisão VeriTime™ (IEEE 1588v2) da Microsemi e criptografia Intellisec™ (MACsec 128/256 bits). Ele também suporta funcionalidade 10GBASE-KR dual-sided, incluindo negociação automática e treinamento em um formato pequeno e de baixo consumo FCBGA, ideal para uma ampla gama de designs de integridade de sinal em nível de placa e conectividade Ethernet (inteligente) em conformidade com os padrões IEEE em nível de sistema. VeriTime™ é a tecnologia de temporização patenteada da Microsemi que oferece a implementação de temporização IEEE 1588v2 mais precisa da indústria. É a única solução IEEE 1588v2 validada por grandes OEMs em testes do mundo real e adotada como a atualização de baixo custo preferida para atender aos requisitos emergentes em 4G/LTE-Advanced (LTE-A). Com sua integração de VeriTime, o VSC8254-01 oferece o método mais rápido e de menor custo para implementar a precisão de temporização de rede que é crítica para manter os níveis de serviço existentes à medida que as arquiteturas dos provedores migram de tecnologias TDM para baseadas em pacotes. O dispositivo VSC8254-01 suporta quadros PTP de 1 passo e 2 passos para modos de operação de clock comum, clock de fronteira e clock transparente, juntamente com capacidades completas de monitoramento de desempenho OAM Y.1731. Intellisec™ é a extensão patenteada da Microsemi baseada em fluxo da solução MACsec ponta a ponta baseada em IEEE 802.1AE para comunicações confidenciais em quaisquer conexões de provedor de serviços Ethernet MEF CE 2.0 ou MPLS. É o primeiro MACsec forte CGM-AES de 256 bits certificado FIPS 197 do mundo, com suporte legado para implantações atuais de campo CGM-AES de 128 bits. O dispositivo VSC8254-01 suporta criptografia em velocidade total de linha em velocidades de 1 GbE e 10 GbE em múltiplos tipos de mídia. O dispositivo VSC8254-01 fornece um conjunto completo de instrumentação on-chip, incluindo funções de autoteste (BIST), loopbacks de circuito do lado da linha e do lado do cliente, geração de padrões e detecção de erros. Suas opções de clock altamente flexíveis suportam operação LAN e WAN usando uma única taxa de clock de referência de 156,25 MHz. Ethernet Síncrona (SyncE) e comutação de failover para roteamento de proteção também são suportadas. O dispositivo VSC8254-01 oferece excelente atenuação de jitter com baixo consumo de energia. Ele é bem adequado para módulos ópticos baseados em SFP+ e cabos de cobre de conexão direta, bem como aplicações desafiadoras de interface de backplane.
ICs de Interfaces de Rede Telecom Ethernet 256-FCBGA (17x17)Especificação:
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Categoria
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Circuitos Integrados (ICs)
Interface - Telecomunicações
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Fabricante
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Microchip Technology
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Série
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-
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Status da Peça
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Ativo
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Função
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Ethernet
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Interface
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SPI
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Número de Circuitos
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2
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Tensão - Alimentação
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970mV, 1.2V
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Corrente - Alimentação
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-
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Datasheet
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-
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Tipo de Montagem
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Montagem em Superfície
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Pacote / Caixa
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256-BBGA, FCBGA
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Pacote do Dispositivo Fornecedor
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256-FCBGA (17x17)
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Número do Produto Base
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Descrição:
Interfaces O dispositivo VSC8254-01 fornece múltiplos tipos de interfaces suportando IEEE 802.1ae, IEEE 802.3ae, IEEE 1588v2 e IEEE 802.3ap com negociação automática e treinamento 10GBASE-KR baseado em hardware. O dispositivo oferece uma integração perfeita entre o IEEE 1588v2 e o motor MACsec sem perda de precisão. A funcionalidade MACsec no dispositivo VSC8254-01 suporta os protocolos MACsec IEEE 802.1AE de 128/256 bits para atender aos requisitos de segurança para proteger dados que trafegam em LANs Ethernet, como classificação de entrada, criptografia/descriptografia de quadros, monitoramento de desempenho e latência. O dispositivo atende aos requisitos do host 1 GbE SFP e SFP+ SR/LR/ER/ZR de acordo com as especificações SFF MSA e compensa os distúrbios ópticos em aplicações SFP+ e degradações do PCB. O receptor de entrada serial de alta velocidade compensa a perda de desempenho ou margem de mídia óptica e de cobre devido à interferência intersimbólica (ISI). A saída de transmissão serial de alta velocidade possui um buffer de saída FIR de 3 taps totalmente compatível com o padrão 10GBASE-KR para fornecer suporte completo a 10GBASE-KR, incluindo a máquina de estados 10GBASE-KR, para negociação automática e otimização de link. O caminho de transmissão incorpora um driver de saída multi-tap para fornecer flexibilidade para atender aos exigentes requisitos de lançamento de saída 10GBASE-KR (IEEE 802.3ap). As portas seriais suportam modos de 1,25 Gbps e 10 Gbps. Cada canal consiste em uma subseção de receptor (Rx) e transmissor (Tx). Entradas de clock de referência programáveis (HREFCK LREFCK e SREFCK) suportam os modos juntamente com recuperação de clock e dados (CDR) nas subseções Rx e Tx de todos os canais. Cada canal do dispositivo pode estar em um modo diferente dentro das limitações dos clocks de referência disponíveis, garantindo que as subseções Rx e Tx dentro de um canal estejam no mesmo modo.
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