TMS320VC5409APGE16 Digitale Signalprozessor IC DSP Integrierte Schaltungen QFP144

TMS320VC5409APGE16 Digitale Signalprozessoren DSP-Integrierte Schaltungen QFP144 Texas Instruments ICs

Beschreibung:

Der feststehende digitale Signalprozessor (DSP) TMS320VC5409A (nachstehend als 5409A bezeichnet)
(sofern nicht anders angegeben) basiert auf einer fortschrittlichen modifizierten Harvard-Architektur, die ein Programm
Dieser Prozessor liefert eine arithmetische Logik-Einheit (ALU) mit einem
hoher Parallelitätsgrad, anwendungsspezifische Hardware-Logik, On-Chip-Speicher und zusätzliche On-Chip-Speicher
Die Basis für die Betriebsflexibilität und -geschwindigkeit dieses DSP ist eine hochspezialisierte Anleitung.
Sie ist eingestellt.

Ein separater Programm- und Datenraum ermöglicht den gleichzeitigen Zugriff auf Programm-Anweisungen und Daten, wobei
Ein hoher Parallelitätsgrad. Zwei Leseoperationen und eine Schreiboperation können in einer einzigen
Instruktionen mit Parallelspeicher und anwendungsspezifischen Anweisungen können diese Architektur voll ausnutzen.
Darüber hinaus können Daten zwischen Daten- und Programmräumen übertragen werden.
Ein leistungsfähiger Satz von arithmetischen, logischen und Bit-Manipulation Operationen, die alle in einem einzigen
Die Regelung 5409A umfaßt auch die Steuerungsmechanismen zur Steuerung von Unterbrechungen, wiederholten
Operationen und Funktionsanrufe.

Spezifikation:Festpunkt-Digitalsignalprozessor IC

Eigenschaften:

Erweiterte Multibus-Architektur mit drei separaten 16-Bit-Datenspeicherbussen und einem

• Programmmemorybus für bedingte Speicherinstruktionen

• Schnelle Rückkehr nach einer Unterbrechung

• 40-Bit-Arithmetische Logik-Einheit (ALU) mit einem

• On-Chip Peripheriegeräte 40-Bit-Barrel Shifter und zwei unabhängige Software-programmierbare Warte-State 40-Bit-Akkumulatoren Generator und Programmierbar

• 17- × 17-Bit Parallel Multiplier Coupled to a Bank-Switching 40-Bit Dedicated Adder for Non-Pipelined – On-Chip Programmable Phase-Locked Single-Cycle Multiply/Accumulate (MAC) Loop (PLL) Clock Generator With Internal Operation Oscillator or External Clock Source(1) • Compare, Auswahl und Speichereinheit (CSSU) für den

• Exponentencoder zur Berechnung eines Exponentenwerts von 3 mehrkanallichen pufferten seriellen Ports, einem 40-Bit-Akkumulatorwert in einem (McBSPs) Single Cycle

• Zwei Adressgeneratoren mit acht Hilfs-Schnittstellen (HPI8/16) und zwei Hilfsregistern

• Steuerung des Stromverbrauchs mit IDLE1, Arithmetischen Einheiten (ARAU) IDLE2 und IDLE3 Anweisungen mit

• Datenbus mit Bushalter-Funktion Power-Down-Modi • Erweiterter Adressmodus für 8M × 16-Bit

• CLKOUT Off-Control zum Deaktivieren von CLKOUT Maximal Adressierbares externes Programm

• On-Chip-Scan-basierte Emulationslogik, IEEE Space Std 1149.1 (JTAG) Grenzscan-Logik (2)

• 32K × 16-Bit RAM auf dem Chip besteht aus: • 144-Pin Ball Grid Array (BGA) (GGU-Suffix) 4 Blöcke 8K × 16-Bit Dual-Access-Programm/Daten-RAM auf dem Chip

• 144-Pin Low-Profile Quad Flatpack (LQFP) (PGE Suffix) • 16K × 16-Bit ROM auf dem Chip für den Programmspeicher konfiguriert

• 6.25-ns Einzyklus-Festpunkt-Instruktionsdurchführungszeit (160 MIPS) • Erweiterte externe Parallelschnittstelle (XIO2)

• 8.33-ns Einzyklus-Festpunkt-Anleitung

• Ausführungszeit für Einzel-Instruktions- und Block-Wiederholungsvorgänge (120 MIPS) für den Programmcode

• 3,3-V-Eingangs-/Ausgangsspannung (160 und 120 MIPS)

• Block-Speicher-Move-Anweisungen für ein besseres Programm- und Datenmanagement

• 1,6-Volt-Kernversorgungsspannung (160 MIPS)

• Anweisungen mit einem 32-Bit-Wortoperand

• 1,5-V-Kernversorgungsspannung (120 MIPS) (1) Der On-Chip-Oszillator ist nicht auf allen 5409A-Geräten verfügbar.

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